Fuite des processeurs du serveur AMD EPYC Milan-X, jusqu’à 64 cœurs Zen 3 et éventuellement des piles V-Cache 3D

Les processeurs EPYC Milan-X de nouvelle génération d’AMD, qui comprendront un emballage de puces 3D, ont fuité par Momomo_US. La gamme servira de solution intermédiaire avant que la gamme EPYC Genoa alimentée par Zen 4 n’arrive plus tard en 2022-2023.

Fuite des UGS de CPU du serveur EPYC Milan-X d’AMD, jusqu’à 64 cœurs avec la technologie 3D V-Cache ?

AMD a jusqu’à présent confirmé qu’il intégrait la technologie d’empilement de puces 3D V-Cache à son architecture de base Zen 3. La technologie serait d’abord introduite sur les processeurs Ryzen Desktop de nouvelle génération et, à première vue, Milan-X est un autre produit majeur en préparation avec 3D V-Cache. AMD Milan-X est connu depuis un certain temps et sera similaire aux processeurs Milan EPYC 7003 existants, sauf qu’ils subiront des changements majeurs sous la forme d’un empilement de puces.

Carte mère EVGA X570 DARK illustrée dans toute sa splendeur, overclocking monstre pour les processeurs AMD Ryzen

EPYC 73○○X
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— 188号 (@momomo_us) 25 août 2021

Voici les références SKU AMD EPYC 7003X Milan-X qui ont été divulguées :

• EPYC 7773X 64 Noyau (100-000000504)
• EPYC 7573X 32 Noyau (100-000000506)
• EPYC 7473X 24 cœurs (100-000000507)
• EPYC 7373X 16 cœurs (100-000000508)

Fait intéressant, les quatre SKU répertoriés ici conservent le même nombre de cœurs que les variantes actuelles, nous n’allons donc pas voir CCD sur CCD s’empiler si tôt. Les CCD conservent leur nombre de cache intégral, mais bénéficieront du cache SRAM ajouté grâce à l’empilement de puces.

Ce que nous savons maintenant de la technologie 3D V-Cache, c’est qu’elle est obtenue grâce à l’utilisation de Micro Bump (3D) et de plusieurs interconnexions TSV. L’interconnexion utilise une toute nouvelle liaison diélectrique-diélectrique hydrophile avec liaison directe CU-CU qui a été conçue et co-optimisée en partenariat avec TSMC. Les deux siliciums individuels (chiplets) sont liés ensemble à l’aide de cette technologie. La technologie 3D comprend 9 liaisons Micron Pitch.

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Une seule pile V-Cache 3D incorporerait 64 Mo de cache L3 qui se trouve au-dessus des TSV déjà présents sur les Zen 3 CCD existants. Le cache s’ajoutera aux 32 Mo existants de cache L3 pour un total de 96 Mo par CCD. AMD a également déclaré que la pile V-Cache peut aller jusqu’à 8-hi, ce qui signifie qu’un seul CCD peut techniquement offrir jusqu’à 512 Mo de cache L3 en plus des 32 Mo de cache par Zen 3 CCD. Ainsi, avec un cache L3 de 64 Mo, vous pouvez techniquement obtenir jusqu’à 768 Mo de cache L3 (8 piles CCD V-Cache 3D = 512 Mo), ce qui représentera une augmentation gigantesque de la taille du cache.

3D V-Cache ne pourrait être qu’un aspect de la gamme EPYC Milan-X. AMD pourrait introduire des horloges plus rapides alors que 7 nm continue de mûrir et nous pouvons voir des performances beaucoup plus rapides de ces puces empilées. Il est également intéressant de noter que les codes OPN de ces processeurs sont prêts, ce qui signifie qu’un lancement d’ici la fin de 2022 est très probable, ce qui signifierait que Milan-X pourrait être la première puce à introduire le V-Cache 3D.

Familles de processeurs AMD EPYC :